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如何看懂數字邏輯電路
數字電子電路中的后起之秀是數字邏輯電路。把它叫做數字電路是因為電路中傳遞的雖然也是脈沖，但這些脈沖是用來表示二進制數碼的，例如用高電平表示“ 1 ”，低電平表示“ 0 ”。聲音圖像文字等信息經過數字化處理后
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無穩(wěn)態(tài)觸發(fā)器
很實用的經典電路。
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一種基于EPLD技術的抗干擾濾波器的實現(xiàn)
1問題的提出 在同步串行數據傳輸過程中，時鐘線上只要有一點小毛刺就會導致數據傳輸失誤，從而影響系統(tǒng)的正常工作。傳統(tǒng)的處理方法是在接收端并入一小電容來濾除毛刺，這種方法只能去除某一固定頻率下的干擾，
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基于FPGA的多通道校準算法的同步實現(xiàn)
數字信號處理模塊是接收機系統(tǒng)的核心部分，系統(tǒng)要求數字信號處理模塊能實時處理ADC變換后的數字信號，并用軟件的方法來實現(xiàn)大量的無線電功能，這些功能包括：多通道校準、編解碼、調制解調、濾波、同步、盲均衡、
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基于FPGA的多通道校準算法的同步實現(xiàn)
數字信號處理模塊是接收機系統(tǒng)的核心部分，系統(tǒng)要求數字信號處理模塊能實時處理ADC變換后的數字信號，并用軟件的方法來實現(xiàn)大量的無線電功能，這些功能包括：多通道校準、編解碼、調制解調、濾波、同步、盲均衡、
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一款雷達芯片的基于掃描路徑法可測性設計
針對一款雷達芯片電路采用基于掃描路徑法的可測性設計，在設計過程中采用時鐘復用技術、IP隔離技術，以及針對具體的時鐘產生電路采用了其他特殊處理技術；通過采用多種恰當有效的可測性設計策略后，大大提高了該芯片電路可測性設計的故障覆蓋率，最終其測試覆蓋率可達到97％，完全滿足設計指標的要求。
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用來驅動觸發(fā)器閃光電路的時鐘
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教學示范用的觸發(fā)器
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觸發(fā)器驅動可控硅
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FPGA深層解析
概覽 高端設計工具為少有甚是沒有硬件設計技術的工程師和科學家提供現(xiàn)場可編程門陣列(FPGA)。無論你使用圖形化設計程序，ANSI C語言還是VHDL語言，如此復雜的合成工藝會不禁讓人去想FPGA真實的運作情況。在這個芯
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FPGA深層解析
概覽 高端設計工具為少有甚是沒有硬件設計技術的工程師和科學家提供現(xiàn)場可編程門陣列(FPGA)。無論你使用圖形化設計程序，ANSI C語言還是VHDL語言，如此復雜的合成工藝會不禁讓人去想FPGA真實的運作情況。在這個芯
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基于TCA785和FPGA的觸發(fā)器設計
摘 要： 以晶閘管構成的全橋整流電路為對象，分析和建立了兩種觸發(fā)器以實現(xiàn)對晶閘管的觸發(fā)控制。一種是以TCA785為核心芯片的模擬觸發(fā)器，另一種是以可編程邏輯陣列（FPGA）為核心芯片的數字觸發(fā)器。試驗表明兩種觸
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基于單片機的晶閘管觸發(fā)器的設計
詳述了基于AT89C2051單片機的晶閘管觸發(fā)器的硬件構成和軟件設計方案。分析和應用了移相觸發(fā)脈沖控制理論，其控制方案簡單和便于調節(jié)，是一種具有很高實用價值的控制方案。
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單片式開關穩(wěn)壓器DN-25構成的開關穩(wěn)壓電源
如圖所示為由DN-25集成電路的開關穩(wěn)壓電源。DN-25是單片開關型穩(wěn)壓電源器件，適合制作中等輸出電流、寬調壓范圍的穩(wěn)壓電源。它的主要性能指標如下：輸入電壓VIN=3～40V，輸出電壓Vo=1.25～24V(連續(xù)可調)，最大輸出電
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單片式開關穩(wěn)壓器DN-25構成的開關穩(wěn)壓電源
單片式開關穩(wěn)壓器DN-25構成的開關穩(wěn)壓電源
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