21ic訊 賽靈思公司 （Xilinx, Inc.）日前宣布推出 ISE® 13.4設(shè)計套件。該設(shè)計套件可提供對 MicroBlaze™ 微控制器系統(tǒng) (MCS) 的公共訪問功能、面向 28nm 7 系列 FPGA 的全新 RX 裕量分析和調(diào)試功能，以及支持面向 Artix™-7 系列和 Virtex®-7 XT 器件的部分可重配置功能。

MicroBlaze MCS 可顯著簡化微控制器設(shè)計
MicroBlaze MCS 是賽靈思 LogiCORE™ IP核解決方案的新成員，可為賽靈思客戶提供交鑰匙微控制器解決方案。它包含 MicroBlaze 處理器、用于程序和數(shù)據(jù)存儲的本地存儲器，以及緊密耦合的 GPIO、時鐘、中斷控制器和其它標(biāo)準(zhǔn)外設(shè)。

MCS 得到了眾多賽靈思 FPGA 系列器件的廣泛支持，經(jīng)預(yù)配置可幫助硬件開發(fā)人員簡化部署工作。不僅軟件開發(fā)人員會發(fā)現(xiàn)一些熟悉的工具，諸如賽靈思軟件開發(fā)套件 (SDK)、命令行 gcc、賽靈思微處理器調(diào)試器 (XMD) 和與較大型處理器配置使用相同標(biāo)準(zhǔn)的MicroBlaze API，而且硬件開發(fā)人員也將欣慰地發(fā)現(xiàn)，除了得到Cadence、Mentor和賽靈思仿真解決方案的支持外，MicroBlaze 處理器和所有的賽靈思嵌入式 IP 核現(xiàn)在還得到了 Synopsys VCS 仿真器的支持。MicroBlaze MCS 現(xiàn)包含在ISE 設(shè)計套件的所有版本和 ISE WebPACK 中，并與 AutoESL™ 高級綜合工具 v2011.4 版兼容。

全新 RX 裕量分析工具
ISE 13.4 版中提供的 ChipScope™ Pro 工具現(xiàn)提供一款 RX 裕量分析工具，可幫助工程師優(yōu)化信號質(zhì)量，降低設(shè)計誤碼率 (BER)。RX 裕量分析工具采用二維眼圖掃描統(tǒng)計算法，可以通過交互方式實時地或者在運行后處理過程中表征和優(yōu)化信道質(zhì)量。

第四代部分可重配置功能
PlanAhead™ 工具現(xiàn)可提供支持面向 Artix-7 和 Virtex-7 FPGA 的部分可重配置功能。部分可重配置功能可以動態(tài)地重配置邏輯模塊，同時不影響其他邏輯的運行。這就意味著設(shè)計人員可使用 Artix-7 和 Virtex-7 XT 器件構(gòu)建高度靈活的系統(tǒng)，能夠在運行過程中更換功能或者進行遠程更新。此外，部分可重配置功能還可讓設(shè)計人員通過充分利用時間復(fù)用的優(yōu)勢，即采用尺寸更小、數(shù)量更少的器件，減少板級空間和最大限度地降低比特流的存儲要求，最終降低成本和設(shè)計尺寸。采用更小和更少的器件還可降低系統(tǒng)功耗，而更換出高耗能任務(wù)則能夠最大限度地降低 FPGA 的動態(tài)功耗。這標(biāo)志著賽靈思首次可面向從低成本到高端的所有7系列 FPGA產(chǎn)品提供部分可重配置功能。

賽靈思軟件和工具市場營銷高級總監(jiān) Tom Feist 指出：“隨著硬件設(shè)計越來越多地使用點對點總線，以更快的傳輸速度發(fā)送更大型的數(shù)據(jù)包，因此設(shè)計工程師應(yīng)該更加重視這類設(shè)計所要求的質(zhì)量、誤碼率和裕量等。提升設(shè)計人員的工作效率仍然是賽靈思的重中之重。ISE 13.4 設(shè)計套件可進一步豐富和簡化我們的開發(fā)工具，確保它們的簡便易用性，并為在這些設(shè)計中部署我們整個 7 系列 FPGA 提供支持。”

擴展對 7 系列 FPGA 的支持
ISE 13.4 設(shè)計套件是首個支持 Artix-7 和 Virtex-7 XT FPGA 系列的公開版本。
Extends Support for 7 Series FPGAs
ISE Design Suite 13.4 is the first public release supporting the Artix-7 and Virtex-7 XT FPGA families.

Artix-7 FPGA 具有業(yè)界最低的功耗和成本，可廣泛應(yīng)用于消費類 3D 電視、多功能打印機、數(shù)碼單反相機、汽車駕駛員輔助和信息娛樂、低功耗手持通信、醫(yī)療內(nèi)窺鏡、手持超聲設(shè)備以及工業(yè)系統(tǒng)監(jiān)控和控制等大批量市場的需求。所有的 28nm 賽靈思器件均具有靈活混合信號 (AMS) 功能，故設(shè)計人員可運用此業(yè)界最為靈活的通用模擬接口定制各種應(yīng)用，從簡單的控制與排序到諸如線性化、校正和濾波等信號處理強度更大的任務(wù)。

Virtex-7 XT 器件采用高性能收發(fā)器、數(shù)字信號處理器 (DSP) 和 BRAM 可提供最高處理帶寬。Virtex-7 XT 器件前所未有地集成了多達 96 個 10G Base KR 背板功能串行收發(fā)器，DSP性能高達 5.3 TMAC ，并內(nèi)置有67Mb 的內(nèi)部存儲器和超過 100 萬個邏輯單元。Virtex-7 XT 系列采用賽靈思具有革命性創(chuàng)新的堆疊硅片互聯(lián)技術(shù) (SSI) 將多個晶片集成到單個芯片中，與多芯片解決方案相比，單芯片解決方案的芯片間單位功耗帶寬可提高100倍。

PlanAhead 工具可顯著提高用戶生產(chǎn)率
賽靈思ISE PlanAhead 設(shè)計和分析工具是一種可用于設(shè)計創(chuàng)建、分析、布局和實現(xiàn)的綜合性開發(fā)環(huán)境。PlanAhead 工具采用獨特的 front-to-back 環(huán)境，能夠為設(shè)計周期的每一個階段 —— RTL 開發(fā)、IP 集成、驗證、綜合、布局布線 —— 提供設(shè)計分析功能，從而加速量產(chǎn)進程。采用該工具，可減少費時費力的設(shè)計迭代，快速權(quán)衡功耗、資源利用和性能要求。前端的設(shè)計分析和設(shè)計保護流程可確保流程間的時間恰到好處，對用戶充分發(fā)揮新型 7 系列器件的功能具有至關(guān)重要的意義。
PlanAhead 工具目前可針對賽靈思 7 系列 FPGA 提供公共訪問功能，不僅能夠提升工作效率，幫助用戶快速完成設(shè)計，而且其具備的智能時鐘門控技術(shù)還能大幅降低功耗。此外，其現(xiàn)在為Artix-7 FPGA 和 Virtex-7 XT FPGA 提供的團隊設(shè)計流程與第五代部分可重配置技術(shù)也可精減所使用器件的數(shù)量和尺寸，進而降低功耗、改進系統(tǒng)的升級能力。

ISE 13 設(shè)計套件的所有 ISE 版本現(xiàn)已開始供貨，邏輯版本起價為 2,995 美元，目前支持 32 位和 64 位 Windows 7 操作系統(tǒng)。客戶可從賽靈思網(wǎng)站免費下載ISE 13 設(shè)計套件的全功能 30 天評估版本。