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[導(dǎo)讀]21ic訊 SiliconLabs(芯科實(shí)驗(yàn)室有限公司,NASDAQ:SLAB)今天宣布推出PCIExpress(PCIe)Gen1/2/3扇出緩沖器,此產(chǎn)品為包括服務(wù)器、存儲(chǔ)器和交換機(jī)在內(nèi)的數(shù)據(jù)中心應(yīng)用而設(shè)計(jì)。針對(duì)當(dāng)今領(lǐng)先的x86主板和服務(wù)器系統(tǒng),新型的S

21ic訊 SiliconLabs(芯科實(shí)驗(yàn)室有限公司,NASDAQ:SLAB)今天宣布推出PCIExpress(PCIe)Gen1/2/3扇出緩沖器,此產(chǎn)品為包括服務(wù)器、存儲(chǔ)器和交換機(jī)在內(nèi)的數(shù)據(jù)中心應(yīng)用而設(shè)計(jì)。針對(duì)當(dāng)今領(lǐng)先的x86主板和服務(wù)器系統(tǒng),新型的Si5310x/11x/019 PCIe緩沖器是業(yè)內(nèi)最高能效的扇出緩沖器,有效擴(kuò)展了Silicon Labs不斷壯大的PCIe計(jì)時(shí)產(chǎn)品線。憑借靈活的輸出數(shù)量選項(xiàng),新型的PCIe緩沖器能夠完整滿足98%的基于x86的服務(wù)器/存儲(chǔ)器主板設(shè)計(jì)需求。

 

 

多年以來,數(shù)據(jù)中心設(shè)備制造商不得不在有限的供應(yīng)商中選擇通過主要x86CPU和芯片組供應(yīng)商認(rèn)證的PCIeGen3緩沖器。這些傳統(tǒng)的PCIe緩沖器通常基于十分耗電的恒流輸出技術(shù),每個(gè)輸出至少需要4個(gè)片外終端電阻器以及一個(gè)參考電阻器,增加了物料清單(BOM)成本。隨著能耗和散熱成本逐漸成為數(shù)據(jù)中心設(shè)計(jì)的關(guān)鍵所在,開發(fā)人員越來越傾向于尋求那些既能提供最大能源效率,又符合嚴(yán)格的x86主板規(guī)格的計(jì)時(shí)產(chǎn)品。SiliconLabs的Si5310x/11x/019系列產(chǎn)品能夠?yàn)樵O(shè)備制造商提供低功耗、標(biāo)準(zhǔn)兼容的PCIe緩沖器產(chǎn)品,這些產(chǎn)品不僅通過了主要x86 CPU和芯片組供應(yīng)商的認(rèn)證,而且也獲得強(qiáng)大的技術(shù)支持。

超過90%以上的現(xiàn)有主板設(shè)計(jì)依舊采用基于恒流輸出技術(shù)的PCIe緩沖器。為了滿足這些現(xiàn)有市場的需求,SiliconLabs新型Si53019PCIe恒流緩沖器提供了一個(gè)完全認(rèn)證的直接替換兼容解決方案,并且與傳統(tǒng)解決方案相比,能耗減少30%。

為了進(jìn)一步降低功耗,SiliconLabs的Si5310x和Si5311x器件使用創(chuàng)新的推挽輸出架構(gòu),可提供業(yè)界最低能耗的PCIe緩沖器系列產(chǎn)品。這些器件比恒流緩沖器減少60%的功耗,同時(shí)減少每路輸出所需的片外電阻器,顯著的減少了片外器件數(shù)量,簡化了印刷電路板(PCB)的設(shè)計(jì)。例如,通過使用SiliconLabs的19路輸出的Si53119推挽緩沖器代替?zhèn)鹘y(tǒng)的恒流器件,開發(fā)人員能夠節(jié)省將近1W的能耗,并且減少了39個(gè)片外器件。

針對(duì)采用新型基于ARM®SoC的超大規(guī)模服務(wù)器和存儲(chǔ)市場的系統(tǒng)設(shè)計(jì),SiliconLabs的Si5310x和Si5311x推挽輸出芯片也是最佳的PCIe計(jì)時(shí)解決方案。與基于x86的設(shè)計(jì)相似,應(yīng)用于服務(wù)器和存儲(chǔ)設(shè)備的基于ARM的SoC平臺(tái),使用PCIe作為主要的系統(tǒng)數(shù)據(jù)總線和互連方式。隨著系統(tǒng)級(jí)能效逐漸成為超大規(guī)模架構(gòu)的關(guān)鍵所在,采用推挽輸出的新型Si5310x和Si5311x器件便成為了服務(wù)器和存儲(chǔ)平臺(tái)設(shè)計(jì)的理想選擇(無論其采用何種CPU架構(gòu))。

除了考慮能耗之外,數(shù)據(jù)中心設(shè)備的制造商也面臨著保持信號(hào)完整性的挑戰(zhàn),因?yàn)橥ǔP枰陂L達(dá)60英寸的電路板之間傳輸時(shí)鐘信號(hào)。在如此長的距離中,PCIe時(shí)鐘的上升和下降時(shí)間將延長并變慢,這也導(dǎo)致抖動(dòng)性能降低,系統(tǒng)丟包率升高。SiliconLabs的PCIeGen3緩沖器設(shè)計(jì)旨在能夠提供長距離時(shí)鐘信號(hào)傳輸,同時(shí)保持兼容標(biāo)準(zhǔn)的PCIe上升和下降時(shí)間規(guī)格,從而防止抖動(dòng)增加和丟包率上升。

SiliconLabs的新型PCIe緩沖器系列產(chǎn)品支持6、8、12、15、19路輸出,同時(shí)具有恒流和推挽輸出緩沖器,這使得開發(fā)人員能夠?yàn)槊總€(gè)應(yīng)用定制最佳的計(jì)時(shí)解決方案。SiliconLabs的芯片與傳統(tǒng)PCIe緩沖器引腳和功能兼容,憑借增強(qiáng)能源效率、信號(hào)完整性和抖動(dòng)性能,可提供給開發(fā)人員最優(yōu)秀的可選方案。

SiliconLabs時(shí)鐘產(chǎn)品營銷總監(jiān)JamesWilson表示:“移動(dòng)互聯(lián)網(wǎng)流量和云計(jì)算正在推動(dòng)更快、更高性能的數(shù)據(jù)中心設(shè)備選擇支持PCIe標(biāo)準(zhǔn)和主要x86規(guī)范的高精度計(jì)時(shí)解決方案。我們已經(jīng)擴(kuò)展了PCIe計(jì)時(shí)產(chǎn)品線,現(xiàn)在包括完全符合x86規(guī)范的PCIeGen3扇出緩沖器,能夠極大降低數(shù)據(jù)中心設(shè)備的功耗、成本和復(fù)雜性。我們新型的PCIe產(chǎn)品有效補(bǔ)充了Silicon Labs的任意頻率時(shí)鐘發(fā)生器,為服務(wù)器、交換機(jī)和存儲(chǔ)設(shè)計(jì)提供了單芯片時(shí)鐘樹解決方案。”

SiliconLabs提供廣泛的時(shí)鐘產(chǎn)品線,包括頻率靈活的時(shí)鐘發(fā)生器、抖動(dòng)衰減器、時(shí)鐘緩沖器、PCIe時(shí)鐘和振蕩器,能夠滿足各類物聯(lián)網(wǎng)基礎(chǔ)設(shè)施應(yīng)用。這些高性能的計(jì)時(shí)解決方案使得開發(fā)人員能夠通過單一的一站式購齊的供應(yīng)商,為數(shù)據(jù)中心、核心網(wǎng)絡(luò)、無線基礎(chǔ)設(shè)備、寬帶接入以及測試和測量設(shè)計(jì)提供滿足需求的完整計(jì)時(shí)解決方案。

價(jià)格和供貨

Si531xx和Si53019PCIe扇出緩沖器現(xiàn)在已經(jīng)量產(chǎn),可提供樣片。在一萬片采購量時(shí),Si531xx推挽輸出緩沖器單價(jià)為1.70美元起,Si53019恒流輸出緩沖器單價(jià)為2.85美元起。為了加速采用推挽輸出時(shí)鐘緩沖器的服務(wù)器和存儲(chǔ)應(yīng)用的開發(fā),Silicon Labs提供了Si53108-EK、Si53112-EK和Si53119-EK評(píng)估板,每個(gè)售價(jià)均為125美元(廠商建議零售價(jià))。

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