在選擇器件時，我們常常會對DATASHEET上的技術指標有所取舍，畢竟不是每一項技術指標都對自己想要實現的系統(tǒng)目標造成影響，而對于ADC來說，信噪比(SNR)，毫無疑問是人們重點關注的對象。

模擬-數字轉換器(ADC)是一種將模擬信號轉換成對應數字信號的系統(tǒng)/設備，在人機交互領域有著極其廣泛的應用。ADC可以提供隔離的測量，例如將輸入的模擬電壓或電流轉換為與電壓或電流幅度成正比的數字。在實際應用中，ADC的選型也是一個相當重要的環(huán)節(jié)。

那么除了信噪比之外，其他的技術指標對于我們的系統(tǒng)來說又會產生哪些影響呢?

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分辨率

分辨率，可能是最易被誤解的技術指標，它表示輸出位數，但不提供性能數據。部分數據手冊會列出有效位數(ENOB)，它使用實際SNR測量來計算轉換器的有效性。一種更加有用的轉換器性能指標是噪聲頻譜密度(NSD)，單位為dBm/Hz或HznV。NSD可以通過已知的采樣速率、輸入范圍、SNR和輸入阻抗計算得出(dBm/Hz)。已知這些參數，便可選擇一款轉換器來匹配前端電路的模擬性能，這種選擇ADC的方法比僅僅列出分辨率更有效。

許多用戶還會考慮雜散和諧波性能，這些都與分辨率無關，但轉換器設計人員一般要調整他們的設計，使諧波與分辨率相一致。

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電源抑制(PSR)

電源抑制(PSR)測量電源紋波如何與ADC輸入耦合，顯現在其數字輸出上。如果PSR有限，相對于輸入電平，電源線上的噪聲將僅會受到30至50 dB的抑制。

一般而言，電源上的無用信號與轉換器的輸入范圍相關。例如，如果電源上的噪聲是20 mV rms ，而轉換器輸入范圍是0.7 Vrms，，則輸入上的噪聲是–31 dBFS。如果轉換器的PSR為 30 dB，則相干噪聲會在輸出中顯現為一條–61 dBFS譜線。在確定電源將需要多少濾波和去耦時，PSR尤其有用，PSR在醫(yī)療應用或工業(yè)應用等高噪聲環(huán)境中非常重要。

圖1.電源紋波抑制比(PSRR)vs.頻率

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共模抑制(CMR)

共模抑制(CMR)測量共模信號存在時所引起的差模信號。許多ADC采用差分輸入來實現對共模信號的高抗擾度，因為差分輸入結構本身能抑制偶數階失真產物。

與PSR一樣，電源紋波、接地層上產生的高功率信號、混頻器和RF濾波器的RF泄漏以及能夠產生高電場和磁場的應用會引入共模信號，雖然許多轉換器未規(guī)定CMR，但他們通常具有50至80 dB的CMR。

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時鐘相關技術指標

時鐘相關技術指標，盡管比較重要，但并不總是作出規(guī)定，而且可能難以確定。

圖2. 輸入時鐘與采樣噪聲的關系

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時鐘壓擺率

時鐘壓擺率是實現額定性能所需的最小壓擺率。多數轉換器在時鐘緩沖器上有足夠的增益，以確保采樣時刻界定明確，但如果壓擺率過低使得采樣時刻很不確定，將產生過量噪聲。如果規(guī)定最小輸入壓擺率，用戶應滿足該要求，以確保額定噪聲性能。

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孔徑抖動

孔徑抖動是ADC的內部時鐘不確定性。ADC的噪聲性能受內部和外部時鐘抖動限制。

在典型的數據手冊中，孔徑抖動僅限轉換器。外部孔徑抖動以均方根方式與內部孔徑抖動相加。對于低頻應用，抖動可能并不重要，但隨著模擬頻率的增加，由抖動引起的噪聲問題變得越來越明顯。如果不使用充足的時鐘，性能將比預期要差。

除由于時鐘抖動而增加的噪聲以外，時鐘信號中與時鐘不存在諧波關系的譜線也將顯現為數字化輸出的失真。因此，時鐘信號應具有盡可能高的頻譜純度。

孔徑延遲是采樣信號的應用與實際進行輸入信號采樣的時刻之間的時間延遲。此時間通常為納秒或更小，可能為正、為負或甚至為零。除非知道精確的采樣時刻非常重要，否則孔徑延遲并不重要。

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轉換時間和轉換延遲

轉換時間和轉換延遲是兩個密切相關的技術指標。轉換時間一般適用于逐次逼近型轉換器(SAR)，這類轉換器使用高時鐘速率處理輸入信號，輸入信號出現在輸出上的時間明顯晚于轉換命令，但早于下一個轉換命令。轉換命令與轉換完成之間的時間稱為轉換時間。

轉換延遲通常適用于流水線式轉換器。作為測量用于產生數字輸出的流水線(內部數字級)數目的技術指標，轉換延遲通常用流水線延遲來規(guī)定。通過將此數目乘以應用中使用的采樣周期，可計算實際轉換時間。

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喚醒時間

喚醒時間，為了降低功耗敏感型應用的功耗，器件通常在相對不用期間關斷，這樣做確實可以節(jié)省大量功耗，但器件重新啟動時，內部基準電壓源的穩(wěn)定以及內部時鐘的功能恢復都需要一定的時間，此時轉換的數據將不滿足技術指標。

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輸出負載

輸出負載，同所有數字輸出器件一樣，ADC，尤其是CMOS輸出器件，規(guī)定輸出驅動能力。出于可靠性的原因，知道輸出驅動能力比較重要，但最佳性能一般是在未達到完全驅動能力時。

在高性能應用中，重要的是，將輸出負載降至最低，并提供適當的去耦和優(yōu)化布局，以盡可能降低電源上的壓降。為了避免此類問題發(fā)生，許多轉換器都提供LVDS輸出。LVDS具有對稱性，因此可以降低開關電流并提高總體性能。如果可以，應該使用LVDS輸出以確保最佳性能。

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未規(guī)定標準

未規(guī)定標準，一個至關重要的未規(guī)定項目是PCB布局。雖然可規(guī)定內容的不多，但它會顯著影響轉換器的性能。例如，如果應用未能采用充足的去耦電容，就會存在過多的電源噪聲。由于PSR有限，電源上的噪聲會耦合到模擬輸入中，并破壞數字輸出頻譜，如圖3所示。

圖3a. 電容與性能

圖3b. 有限電容與性能

這些示例顯示了不同的場景和應用需求如何影響ADC架構的選擇。工程師可以通過了解不同ADC類型的性能特征和權衡，做出符合其各自應用目標和限制的明智選擇?？蓴U展性和開發(fā)需求的可能性也是必不可少的考慮因素，尤其是在快速發(fā)展的行業(yè)中。