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[導(dǎo)讀] (全球TMT2021年12月10日訊)Analog Devices, Inc.?(Nasdaq: ADI)宣布推出突破性的RadioVerse?片上系統(tǒng)(SoC)系列,為射頻單元(RU)開發(fā)人員提供靈活且經(jīng)濟(jì)高效的平臺(tái),以創(chuàng)建業(yè)內(nèi)高能效5G RU。新推出的SoC系列提供先進(jìn)的R...

(全球TMT2021年12月10日訊)Analog Devices, Inc.?(Nasdaq: ADI)宣布推出突破性的RadioVerse?片上系統(tǒng)(SoC)系列,為射頻單元(RU)開發(fā)人員提供靈活且經(jīng)濟(jì)高效的平臺(tái),以創(chuàng)建業(yè)內(nèi)高能效5G RU。新推出的SoC系列提供先進(jìn)的RF信號(hào)處理,擴(kuò)展了數(shù)字功能和RF容量,可以大幅提高5G RU性能和能源效率。這些SoC是ADI的RadioVerse生態(tài)系統(tǒng)的最新成員,融合了獲得殊榮的零中頻?(ZiF)架構(gòu),以及功能集成和線性度方面的重大技術(shù)進(jìn)步。ADI的RadioVerse器件是在全球4G和5G RU中應(yīng)用廣泛的軟件定義收發(fā)器。

ADI宣布推出RadioVerse片上系統(tǒng)系列

ADRV9040是新推出的RadioVerse SoC系列中的首款產(chǎn)品。它提供8個(gè)帶寬為400MHz的發(fā)送和接收通道,集成先進(jìn)的數(shù)字信號(hào)處理功能,包括載波數(shù)字上變頻器(CDUC)、載波數(shù)字下變頻器(CDDC)、削峰(CFR)和數(shù)字預(yù)失真(DPD)。利用這種擴(kuò)展的信號(hào)處理,就無需再使用現(xiàn)場可編程門陣列(FPGA),從而可減少發(fā)熱結(jié)構(gòu)、減小總系統(tǒng)尺寸、重量、功率和成本。SoC的DPD算法采用先進(jìn)的機(jī)器學(xué)習(xí)技術(shù)開發(fā),并與主要的功率放大器(PA)供應(yīng)商密切合作進(jìn)行優(yōu)化,以減輕設(shè)計(jì)負(fù)擔(dān),提供出色的寬帶寬性能。該算法在4G和5G用例中得到了全面的測試和驗(yàn)證,包括氮化鎵(GaN)在內(nèi)的多種PA技術(shù)類型。此外,ZiF射頻架構(gòu)可以簡化RF濾波和信號(hào)鏈組件,降低RU成本,縮短不同頻段和功率要求的產(chǎn)品開發(fā)時(shí)間。 

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